AMD760MP_760MPX芯片解密

AMD762导入一种称为AdvanceCache Control的架构。在解说这种架构之前，先提一下英特尔(工ntel对于其双/多处理器总线的设计。
    工nte哟DP , 4P或8P处理器平台，向来都是所谓的共享型总线设计(SharedBus>，假使以PC工33支持双CPU的工ntel815E或V工A  694X主机板而言，CPUO与
CPU1两个133MHz外频的CPU，一同连接到一组133MHz的内存总线，共享133MHz x8byte/clock=1064GB/s的资料传输带宽，每一颗CPU能分配到的仅仅只有532MB/s带宽而己:如果是四组CPU平台<4P>，情况还会更糟，每颗CPU只享用到四分之一的传输带宽(降为266MB/s)。
    即使是XEON处理器所搭配的86(>芯片解密组，使用双通道DirectRambus内存，内存带宽以一举跨到3.2GB/s，可是读者别忘了，光是单一处理器架构的850
芯片解密组，单一颗Pentium4处理器400MHz外频，却只能共享3.2GB/s的带宽，可以直接连接、独享3.2GB/s的设计，而860芯片解密组接上两颗XEON处理器时，
谷目有400MHz外频，却只能共享3.2GB/s的带宽，每一颗分配到的就剩下1.6GB/s而己。因此，工nte向来在服务器的CPU强调其L2 Cache要越大越好，因为这样
才能尽量让大多数资料，在各CPU的L1,L2 Cache之间流动，而不要对外通过较慢而且被分割的内存传输。现在我们看看AMD对双处理器的总线做法。
    AMD的双处理器总线设计，直接沿用当初DEC开发Alpha处理器的概念，每颗处理器有专属的总线，直接与北桥芯片解密联系控制。以AMD规划的双CPU平台，
CPUO ,CPU   1各自享有266MHz  x8byte/clock=21GB/s的传输带宽，从CPU到北桥芯片解密的总带宽就变成4.26B/s了!
    至于北桥芯片解密到外部DRAM的传输带宽部份，这部份透过DDR266内存的工作，可发挥的传输带宽也有266MHz x8byte/clock=2.1GB/s，无论对内或对外的
带宽，AMD的Dual CPU架构，都不逊于工ntelDual CPU架构。接下来我们看一下关于多处理器在快取资料的协调架构。
    工nte哟缓存协调架构，称为MES工(ModifiedExclusiv.}hared    and工犷valid，代表著CPU对于缓存内容更新的四种状态。简单一点的说法，两颗(或两
颗以上)的CPU，彼此要管好自己所掌控的内存与缓存的对映状态，若有涉及两颗CPU先后读写内存时，缓存之间的协调变得非常重要。
    而工nte的设计方式，是一旦有一颗处理器所拥有的缓存内容不够新(Cache' sdir诗时，了会填入另一颗处理器所拥有的最新缓存资料外，为了缓存一致性
(CacheCoherency)，北桥芯片解密会判定Cache  irrvali然后将最新的缓存资料内容回写回J漫速的DRAM内存中，由于多出了较多的写入/同步修补动作，加上
总线是共享型的设计，难免会造成整体系统执行性能上的若干延迟。

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